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HD6432147SW Scheda tecnica(PDF) 84 Page - Renesas Technology Corp |
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HD6432147SW Scheda tecnica(HTML) 84 Page - Renesas Technology Corp |
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84 / 1140 page  2. CPU 51 2.5.2 メモリ上でのデータ構成 メモリ上でのデータ構成を 図 2.11 に示します。 本 CPU は、メモリ上のワードデータ／ロングワードデータをアクセスすることができ ます。これらは、偶数番地から始まるデータに限定されます。奇数番地から始まるワード データ／ロングワードデータをアクセスした場合、アドレスの最下位ビットは 0 とみなさ れ、1 番地前から始まるデータをアクセスします。この場合、アドレスエラーは発生しま せん。命令コードについても同様です。 70 76 543210 MSB LSB MSB MSB LSB LSB アドレス L番地 L番地 2M番地 2N番地 2N+1番地 2N+2番地 2N+3番地 1ビットデータ バイトデータ ワードデータ ロングワードデータ データ形 データイメージ 2M+1番地 図 2.11 メモリ上でのデータ構成 なお、SP（ER7）をアドレスレジスタとしてスタックをアクセスするときは、必ずワー ドサイズまたはロングワードサイズでアクセスしてください。 |
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