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HD6432147SW Scheda tecnica(PDF) 112 Page - Renesas Technology Corp |
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HD6432147SW Scheda tecnica(HTML) 112 Page - Renesas Technology Corp |
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112 / 1140 page  2. CPU 79 2.9 基本動作タイミング 2.9.1 概要 本 CPU は、システムクロック（φ）を基準に動作しています。φの立ち上がりから次 の立ち上がりまでの 1 単位をステートと呼びます。メモリサイクルまたはバスサイクルは、 1 、2 または 3 ステートで構成され、内蔵メモリ、内蔵周辺モジュール、または外部アドレ ス空間によってそれぞれ異なるアクセスを行います。 2.9.2 内蔵メモリ（ROM、RAM） 内蔵メモリのアクセスは 1 ステートアクセスを行います。このとき、データバス幅は 16 ビットで、バイトおよびワードサイズアクセスが可能です。内蔵メモリアクセスサイクル を 図 2.17 に、端子状態を図 2.18 に示します。 内部アドレスバス 内部リード信号 内部データバス 内部ライト信号 内部データバス φ バスサイクル T1 アドレス リードデータ ライトデータ リード時 ライト時 図 2.17 内蔵メモリアクセスサイクル |
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